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Cette soutenance aura lieu à CY Cergy Paris Université, Amphithéâtre Albert Caquot, bâtiment A, 5 Mail Gay-Lussac, 95000, Neuville-sur-Oise
Titre de la thèse : FPGA-SoC based Digital Twins for Power Electronic Converters with Adaptive Embedded Real-Time Simulators
Ces travaux ont été réalisés dans le laboratoire SATIE, dirigés par M. Lahoucine ID-KHAJINE et Co-dirigés par M. Eric MONMASSON